转的一些经验

ssqi980q · 发表于 2009-9-28 17:35:19

鸡毛蒜皮之一：本钱节俭

现象一：这些拉高/拉低的电阻用多大的阻值关系不大，就选个整数5K吧
点评：市场上不存在5K的阻值，最接近的是4.99K（精度1%），其次是5.1K（精度5%），其成本分辨比精度为20%的4.7K高4倍和2倍。20%精度的电阻阻值只有1、1.5、2.2、3.3、4.7、6.8几个种别（含10的整数倍）；相似地，20%精度的电容也只有以上几种值，如果选了其它的值就必须使用更高的精度，成本就翻了几倍，却不能带来任何利益。

现象二：面板上的唆使灯选什么色彩呢？我感到蓝色比拟特殊，就选它吧
点评：其它红绿黄橙等色彩的不管大小（5MM以下）封装如何，都已成熟了几十年，价钱一般都在5毛钱以下，而蓝色却是近三四年才发现的东西，技巧成熟度和供货稳固度都较差，价钱却要贵四五倍。目前蓝色唆使灯只用在不能用其它色彩替换的场所，如显示视频信号等。

现象三：这点逻辑用74XX的门电路搭也行，但太土，还是用CPLD吧，显得高级多了
点评：74XX的门电路只几毛钱，而CPLD至少也得几十块，（GAL/PAL固然只几块钱，但公司不推举使用）。成本提高了N倍不说，还给生产、文档等工作增加数倍的工作。

现象四：我们的系统请求这么高，包含MEM、CPU、FPGA等所有的芯片都要选最快的
点评：在一个高速系统中并不是每一部分都工作在高速状况，而器件速度每提高一个等级，价钱差未几要翻倍，另外还给信号完全性问题带来极大的负面影响。

现象五：这板子的PCB设计请求不高，就用细一点的线，主动布吧
点评：主动布线必定要占用更大的PCB面积，同时发生比手动布线多好多倍的过孔，在批量很大的产品中，PCB厂家降价所斟酌的因素除了商务因素外，就是线宽和过孔数目，它们分辨影响到PCB的成品率和钻头的耗费数目，节俭了供给商的本钱，也就给降价找到了理由。

现象六：程序只要稳固就可以了，代码长一点，效率低一点不是症结
点评：CPU的速度和存储器的空间都是用钱买来的，假如写代码时多花几天时光进步一下程序效力，那么从下降CPU主频和减少存储器容量所节俭的本钱尽对是划算的。CPLD/FPGA设计也相似。

鸡毛蒜皮之二：低功耗设计

现象一：我们这系统是220V供电，就不用在乎功耗问题了
点评：低功耗设计并不仅仅是为了省电，更多的利益在于下降了电源模块及散热系统的成本、由于电流的减小也减少了电磁辐射和热噪声的干扰。随着装备温度的降低，器件寿命则相应延伸（半导体器件的工作温度每进步10度，寿命则缩短一半）

现象二：这些总线信号都用电阻拉一下，感到放心些
点评：信号须要高低拉的原因很多，但也不是个个都要拉。高低拉电阻拉一个单纯的输进信号，电流也就几十微安以下，但拉一个被驱动了的信号，其电流将达毫安级，现在的体系经常是地址数据各32位，可能还有244/245隔离后的总线及其它信号，都上拉的话，几瓦的功耗就耗在这些电阻上了（不要用8毛钱一度电的观念来看待这几瓦的功耗）。

现象三：CPU和FPGA的这些不用的I/O口怎么处置呢？先让它空着吧，以后再说
点评：不用的I/O口如果悬空的话，受外界的一点点干扰就可能成为重复振荡的输进信号了，而MOS器件的功耗基础取决于门电路的翻转次数。如果把它上拉的话，每个引脚也会有微安级的电流，所以最好的措施是设成输出（当然外面不能接其它有驱动的信号）

现象四：这款FPGA还剩这么多门用不完，可纵情施展吧
点评：FGPA的功耗与被使用的触发器数量及其翻转次数成正比，所以同一型号的FPGA在不同电路不同时刻的功耗可能相差100倍。尽量减少高速翻转的触发器数量是降低FPGA功耗的基本方式。

现象五：这些小芯片的功耗都很低，不用斟酌
点评：对于内部不太庞杂的芯片功耗是很难肯定的，它重要由引脚上的电流断定，一个ABT16244，没有负载的话耗电大概不到1毫安，但它的指标是每个脚可驱动60毫安的负载（如匹配几十欧姆的电阻），即满负荷的功耗最大可达60*16=960mA，当然只是电源电流这么大，热量都落到负载身上了。

现象六：存储器有这么多把持信号，我这块板子只须要用OE和WE信号就可以了，片选就接地吧，这样读操作时数据出来得快多了。
点评：大部分存储器的功耗在片选有效时（不论OE和WE如何）将比片选无效时大100倍以上，所以应尽可能使用CS来节制芯片，并且在满足其它要求的情形下尽可能缩短片选脉冲的宽度。

现象七：这些信号怎么都有过冲啊？只要匹配得好，就可打消了
点评：除了少数特定信号外（如100BASE-T、CML），都是有过冲的，只要不是很大，并不一定都需要匹配，即使匹配也并非要匹配得最好。象TTL的输出阻抗不到50欧姆，有的甚至20欧姆，如果也用这么大的匹配电阻的话，那电流就非常大了，功耗是无法接受的，另外信号幅度也将小得不能用，再说一般信号在输出高电温和输出低电平时的输出阻抗并不雷同，也没措施做到完整匹配。所以对TTL、LVDS、422等信号的匹配只要做到过冲可以接收即可。

现象八：下降功耗都是硬件职员的事，与软件没关系
点评：硬件只是搭个舞台，唱戏的却是软件，总线上几乎每一个芯片的拜访、每一个信号的翻转差未几都由软件节制的，如果软件能减少外存的拜访次数（多使用存放器变量、多使用内部CACHE等）、及时响应中断（中断往往是低电平有效并带有上拉电阻）及其它争对具体单板的特定办法都将对降低功耗作出很大的贡献。

鸡毛蒜皮之三：系统效率

现象一：这主频100M的CPU只能处置70%，换200M主频的就没事了
点评：体系的处理才能牵涉到多种多样的因素，在通讯业务中其瓶颈一般都在存储器上，CPU再快，外部拜访快不起来也是徒劳。

现象二：CPU用大一点的CACHE，就应当快了
点评：CACHE的增大，并不必定就导致系统性能的提高，在某些情形下封闭CACHE反而比使用CACHE还快。原因是搬到CACHE中的数据必需得到多次反复应用才会提高系统效率。所以在通讯系统中一般只打开指令CACHE，数据CACHE即使打开也只局限在部分存储空间，如堆栈部分。同时也要求程序设计要统筹CACHE的容量及块大小，这涉及到要害代码循环体的长度及跳转范畴，如果一个循环刚比如CACHE大那么一点点，又在重复循环的话，那就惨了。

现象三：这么多义务到底是用中止还是用查询呢？还是中断快些吧
点评：中断的实时性强，但不必定快。如果中止义务特殊多的话，这个没退出来，后面又相继而至，一会儿系统就将瓦解了。假如义务数目多但很频繁的话，CPU的很大精神都用在进出中断的开销上，体系效率极为低下，如果改用查询方法反而可极大进步效力，但查询有时不能满足实时性请求，所以最好的措施是在中止中查询，即进一次中断就把积聚的所有任务都处置完再退出。

现象四：存储器接口的时序都是厂家默认的配置，不用修正的
点评：BSP对存储器接口设置的默认值都是按最守旧的参数设置的，在实际利用中应联合总线工作频率和等候周期等参数进行公道调配。有时把频率降低反而可提高效率，如RAM的存取周期是70ns，总线频率为40M时，设3个周期的存取时间，即75ns即可；若总线频率为50M时，必须设为4个周期，实际存取时间却放慢到了80ns。

现象五：一个CPU处理不过来，就用两个散布处理，处理才能可提高一倍
点评：对于搬砖头来说，两个人应当比一个人的效率高一倍；对于作画来说，多一个人只能帮倒忙。使用几个CPU需对业务有较多的懂得后才干断定，尽量减少两个CPU间和谐的代价，使1+1尽可能接近2，千万别小于1。

现象六：这个CPU带有DMA模块，用它来搬数据确定快
点评：真正的DMA是由硬件抢占总线后同时启动两端装备，在一个周期内这边读，那边些。但很多嵌进CPU内的DMA只是模仿而已，启动每一次DMA之前要做不少预备工作（设起始地址和长度等），在传输时往往是先读到芯片内暂存，然后再写出往，即搬一次数据需两个时钟周期，比软件来搬要快一些（不须要取指令，没有循环跳转等额外工作），但假如一次只搬几个字节，还要做一堆筹备工作，一般还涉及函数调用，效力并不高。所以这种DMA只对大数据块才实用。

鸡毛蒜皮之四：信号完全性

现象一：这些信号都经过仿真了，尽对没问题
点评：仿真模型不可能与实物一模一样，连不同批次加工的实物都有差异，就更别说模型了。再说实际情形千差万别，仿真也不可能穷举所有可能，尤其是串扰。曾经有一教训是某单板只有特定长度的包极易丢包，最后的原因是长度域的值是0xFF，当这个数据呈现在总线上时，干扰了相邻的WE信号，导致写不进RAM。其它数据也会对WE产生干扰，但干扰在可接收的范围内，可是当8位总线同时由0边1时，邻近的信号就抵挡不住了。结论是仿真成果仅供参考，还应留有足够的余量。

现象二：100M的数据总线应当算高频信号，至于这个时钟信号频率才8K，问题不大
点评：数据总线的值一般是由把持信号或时钟信号的某个边缘来采样的，只要争对这个边沿坚持足够的树立时间和坚持时光即可，此规模之外有干扰也罢过冲也罢都不会有多大影响（当然过冲最好不要超过芯片所能蒙受的最大电压值），但时钟信号不管频率多低（实在频谱规模是很宽的），它的边沿才是要害的，必需保证其单调性，并且跳变时间需在必定范畴内。

现象三：既然是数字信号，边缘当然是越陡越好
点评：边缘越陡，其频谱范畴就越宽，高频部分的能量就越大；频率越高的信号就越轻易辐射（如微波电台可做成手机，而长波电台很多国度都做不出来），也就越轻易干扰别的信号，而自身在导线上的传输质量却变得越差，因此能用低速芯片的尽量应用低速芯片，。

现象四：为保证清洁的电源，往偶电容是多多益善
点评：总的来说去偶电容越多电源当然会更安稳，但太多了也有不利因素：挥霍成本、布线艰苦、上电冲击电流太大等。去偶电容的设计要害是要选对容量并且放对处所，一般的芯片手册都有争对去偶电容的设计参考，最好按手册往做。

现象五：信号匹配真麻烦，如何才干匹配好呢？
点评：总的原则是当信号在导线上的传输时间超过其跳变时光时，信号的反射问题才显得主要。信号发生反射的原因是线路阻抗的不均匀造成的，匹配的目标就是为了使驱动端、负载端及传输线的阻抗变得接近，但能否匹配得好，与信号线在PCB上的拓扑构造也有很大关系，传输线上的一条分支、一个过孔、一个拐角、一个接插件、不同地位与地线间隔的转变等都将使阻抗发生变更，而且这些因素将使反射波形变得异常庞杂，很难匹配，因此高速信号仅应用点到点的方法，尽可能地减少过孔、拐角等问题。

鸡毛蒜皮之五：可靠性设计

现象一：这块单板已小批量生产了，经过长时间测试没发明任何问题
点评：硬件设计和芯片利用必需符合相干规范，尤其是芯片手册中提到的所有参数（耐压、I/O电平范围、电流、时序、温度PCB布线、电源质量等），不能光*实验来验证。公司有不少产品都有过惨痛的教训，产品卖了一两年，IC厂家换了个生产线，咱们的板子就不转了，原因就是人家的芯片参数产生了点变更，但并没有超越手册的范围。如果你以手册为准，那他怎么变更都不怕，如果参数变得超越手册规模了还可找他索赔（假如这时你的板子还能转，那你的可靠性就更牛了）。

现象二：这部分电路只要要求软件这样设计就不会有问题
点评：硬件上很多电气特征直接收软件把持，但软件是经常产生意外的，程序跑飞了之后无法预感会有什么操作。设计者应确保不论软件做什么样的操作硬件都不应在短时间内产生永久性破坏。

现象三：用户操作过错发生问题就不能怪我了
点评：要求用户严厉按手册操作是没错的，但用户是人，就有出错的时候，不能说碰错一个键就逝世机,红孩子，插错一个插头就烧板子。所以对用户可能犯的各种过错必须加以维护。

现象四：这板子坏的原因是对真个板子出问题了，也不是我的义务
点评：对于各种对外的硬件接口应有足够的兼容性，不能由于对方信号不正常，你就歇着了。它不正常只应影响到与其有关的那部分功效，而其它功效应能正常工作，不应彻底罢工，甚至永久破坏，而且一旦接口恢复，你也应立即恢复正常

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